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ARM推出Cortex-A9,实现多内核承诺

    在前不我于美国加州举行的ARM开发者大会上,ARM发布发Cortex系列多内核处理器Cortex-A9。这是继7月份发布ARMx7架构的多处理扩展版本以来的又一次重要产品发布。

    单核的Cortex-A9在性能上大抵相当于已推出的Cortex-A8处理器。但A9系列还有两个、三个乃至四个内核集群的产品,能提供超过8,000Dhrys-tone Mips(DMIPS)的对称多处理(SMP)性能。这种内核是可综合的,采用先进工艺时的时钟频率有望超过1GHz,不过当时钟减慢或内核被关断时才可达到最大功率效率。

   此外,这种架构可扩展到四个以上的内核。“被授权者可根据需要在芯片上配置一个以上的集群。”目前好几家公司已获得授权,其中包括NEC电子、三星、Nvidia、ST和TI。但现在相关芯片还未上市,对于ARM合作伙伴而言,可能要到08年的第一季度才能够确定具体的交付日期。

   A9内核是A8的改进版。“它增加了几条支持多处理的额外指令,并后向兼容。”像A8一样,A9也是超标量体系结构,带有一个多事件8级流水线。程序好前面的分支解算进行异步评估,目的在于取指,每时钟周期允许连续获取和解码两条指令。不过A9流水线更进一步,还支持乱序指令分发及完成。

    这种新的架构带有一个支持硬件加速器和DMA单元的加速器一致性端口(ACP),增强了ARM目前的多处理器能力;带有中断虚拟化功能,支持TrustZone技术;还带有一个通用中断控制器(GIC)。

    A9 Mpcore作为一个完全成熟的ARMx7器件,支持Thumb2指令、ThustZone、浮点运算单元(FPU)与Neon—用于流媒体处理的ARM单指令多数据扩展。与每个内核相关的指令和一级数据缓存都整合了缓存一致性支持,通过了一条本地一致总线与SCU相链接。

    与传统相悖,A9一开始是作为一个可综合内核被提供的.”考虑到对处理而言附加的FPU或Neon、缓存容量、中断方案以及接口等,它还是可配置的。”

    尽管ARM的这一设计还没有完全定案,但该公司已开始授权。此外,预计这一目前以65纳米为基准的设计文件将在45纳米芯片中亮相。

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